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Verilog小白学编程

Verilog小白学编程

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2026年,FPGA大赛中做AI加速器方向,如何用Zynq实现轻量级YOLOv5目标检测并优化功耗?

我们团队今年想冲FPGA大赛国奖,选了AI加速器方向,打算用Zynq做轻量级YOLOv5目标检测,但听说功耗和资源是硬伤。有没有大佬分享过如何用…
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3小时前
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19回答

2026年秋招,模拟IC笔试中关于‘锁相环(PLL)’的题目难度加大,除了基本的鉴相器、电荷泵、VCO、分频器,现在是否会深入考察‘小数分频频率合成器’的杂散抑制、‘自适应带宽控制’以及‘电源噪声抑制(PSR)’的电路实现?该如何针对性复习?

准备模拟IC秋招,发现PLL是笔试和面试的重灾区,题目一年比一年难。以前可能只考线性模型、传递函数、稳定性,现在感觉趋势是考更实际、更复杂的系统…
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25天前
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2026年,芯片行业传出‘部分公司裁撤应届生offer’或‘入职后调岗’的消息,作为已签三方协议的应届生,该如何提前了解公司内部状况,并做好万一被毁约的备选方案?

秋招历经千辛万苦,终于签了一家芯片公司的数字IC设计岗三方协议。但最近在脉脉上看到一些风声,说行业调整,有公司可能裁撤部分应届生岗位或延迟入职,…
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26天前
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13回答

2026年,使用AMD/Xilinx的Vitis HLS和Vitis AI流程,将Python训练的CNN模型部署到Zynq MPSoC上,整个流程中有哪些容易踩的‘坑’和性能优化技巧?

导师的项目需要用ZynqUltraScale+MPSoC做边缘AI推理,推荐我们用VitisHLS和VitisAI工具链。我尝试用PyT…
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2个月前
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2026年秋招,数字IC设计岗位的面试中,‘功耗分析’和‘时序分析’通常会问哪些实际问题?

准备2026年秋招的数字IC设计岗位,看了很多面经,发现除了手撕代码,对后端知识的考察也越来越深。特别是功耗和时序分析,不再是泛泛而谈。想请教一…
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2个月前
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作为FPGA开发者,在项目中使用‘HLS(高层次综合)’工具将C++算法转换为RTL,在实际工程中主要会遇到哪些‘陷阱’?如何保证结果的质量和性能?

学校课题尝试用VitisHLS做了一个图像滤波的加速器,感觉开发速度确实比手写RTL快,但最终资源的利用率和时序感觉不如直接写RTL可控。想请…
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2个月前
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芯片行业的‘产品经理(芯片方向)’需要什么样的技术背景?是更需要资深工程师转岗,还是欢迎应届生培养?

对芯片产品经理的岗位很感兴趣,感觉是技术和市场的结合点。想知道这个岗位通常需要多深的技术背景?比如需要自己看过RTL代码、懂架构权衡吗?招聘时是…
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2个月前
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2025年,芯片行业的“模拟IC设计”和“数字IC设计”岗位,在薪资待遇、职业发展路径和工作强度上,有哪些明显的区别?

我是微电子专业的硕士生,马上要面临秋招选方向,非常纠结。听说模拟IC设计门槛高、岗位少但经验越老越吃香;数字IC设计岗位多、需求大但可能更卷。想…
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2个月前
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2025年,AI芯片公司招聘的‘编译器开发工程师’岗位,需要哪些编译器知识和硬件架构背景?

最近看到很多AI芯片公司在招聘编译器开发工程师,要求熟悉TVM、MLIR等框架。我是计算机专业硕士,有传统编译器(如LLVM)的学习经验,但对A…
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2个月前
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2025年,国内在‘Chiplet’(芯粒)技术领域有哪些值得关注的公司和研究机构?这个方向对人才的需求如何?

最近行业里Chiplet的讨论很多,感觉是未来芯片发展的重要方向。作为即将毕业的微电子硕士,想了解一下国内在这个领域布局比较领先的企业(比如华为…
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2个月前
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