2026年FPGA大赛备赛，用Zynq做实时视频去雾加速器，暗通道先验算法在PL侧实现时BRAM不够用怎么办？

53分钟前

我们小组正在备赛2026年FPGA大赛，选了基于Zynq的实时视频去雾加速器项目。现在用暗通道先验算法在PL侧实现，发现BRAM资源严重不足，已经用了80%多的BRAM，后面还有导向滤波模块没加。请问大家有什么优化策略？比如能不能把部分数据放到DDR里用AXI总线读取？或者有没有更省资源的算法变体？求有经验的大佬指点，最好能给出具体的资源分配方案。

TechNewbie

这家伙真懒，几个字都不愿写！

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