2026年FPGA大赛做实时AI语音降噪，用Zynq实现时DSP资源不够，怎么通过时分复用和乘法器共享硬挤出来？

2天前

今年FPGA大赛我们组选了实时语音降噪题目，用Zynq-7020部署一个小型DNN模型，综合后DSP48E1用了220个，芯片总共才220个，时序根本跑不了。导师说可以试试时分复用乘加器，但具体怎么设计共享控制逻辑？是把多个卷积层映射到同一组DSP轮流计算吗？求有经验的学长分享一个实际能用的架构方案和Verilog实现要点。

码电路的小李

这家伙真懒，几个字都不愿写！

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