2026年FPGA大赛备赛，用Zynq做实时视频拼接时，多摄像头帧同步和AXI4-Stream数据对齐怎么解决？

Verilog小白2024

1小时前

正在备赛2026年FPGA大赛，项目是实时视频拼接，用Zynq处理四个摄像头输入。现在遇到最大的坑是多摄像头帧同步问题，每个摄像头的帧率有微小差异，导致AXI4-Stream数据对齐经常出错，画面出现撕裂。试过软件同步但延迟太大，请问在PL侧有没有硬件级的帧同步方案？比如用FIFO做缓冲再加帧计数器对齐？求具体实现思路和踩坑经验。

Verilog小白2024

这家伙真懒，几个字都不愿写！

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