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2026年FPGA大赛中,用Zynq做实时手势识别,如何从摄像头采集到模型推理实现低延迟加速?
Verilog新手
其他
5天前
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今年FPGA大赛想做一个基于Zynq的实时手势识别系统,目标是延迟在50ms以内。目前卡在从OV5640摄像头采集图像到卷积神经网络推理的流水线设计上,特别是DMA传输和AXI4-Stream接口的时序协调。有没有做过类似项目的同学分享一下具体的模块划分和调试经验?资源优化方面有什么技巧?
Verilog新手
初级工程师
这家伙真懒,几个字都不愿写!
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