2026年，FPGA工程师面试被问如何用Verilog实现一个支持AXI4-Lite的I2C控制器，应届生该从协议转换和中断设计角度如何准备？

22小时前

最近在准备秋招，看到不少公司笔试和面试都爱考AXI4-Lite接口的外设控制器实现。我理解I2C的起始、停止和应答时序，但不知道怎么优雅地把SCL和SDA的边沿检测映射到AXI-Lite的寄存器读写上，中断又是怎么挂到总线上的？有没有大佬分享下从状态机划分到波形仿真的完整思路，最好能结合一个具体的项目举例，比如用Zynq挂个温度传感器。

逻辑初探

这家伙真懒，几个字都不愿写！

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