Quick Start
下载并安装 Vivado（推荐 2023.1 或更新版本），安装时选择“Vivado HLx”并包含目标器件库（如 Artix-7）。打开 Vivado，点击“Quick Start”下的“Create Project”。输入工程名称（如“led_blink”）和路径，勾选“Create project subdirectory”。选择“RTL Project”并勾选“Do not specify sources at this time”。在“Default Part”中选择目标板卡（如“xc7a35tcsg324-1”），或通过“Boards”选项卡选择官方开发板。在“Sources”面板右键点击“Design Sources” → “Add Sources” → “Add or create design sources”，新建一个 Verilog 文件（如“top.v”）。编写简单闪烁代码（例如：50MHz 时钟分频后驱动 LED），保存。在“Flow Navigator”中点击“Run Synthesis”，等待综合完成。综合成功后，点击“Open Synthesized Design”查看 RTL 网表；若需上板，继续点击“Run Implementation” → “Generate Bitstream”。本文原创，作者：FPGA小白，其版权均为FPGA线上课程平台｜最全栈的FPGA学习平台｜FPGA工程师认证培训所有。
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