2026年，FPGA工程师社招面试，被问如何用Verilog实现一个基于AXI4-Stream的实时视频直方图均衡化，面试官说我的流水线有数据冒险怎么改？

4小时前

社招面某芯片公司，面试官让我手撕Verilog实现实时视频直方图均衡化，要求输入是AXI4-Stream的灰度图像，输出也是AXI4-Stream。我写了双流水线结构：第一级计算直方图，第二级做映射。但面试官说我的设计有数据冒险，因为直方图计算和映射在同一帧内会冲突。求大佬指点正确的流水线拆分方案，以及如何用双帧缓冲避免冒险。

FPGA学习笔记

这家伙真懒，几个字都不愿写！

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