2026年，FPGA大赛做实时目标检测，YOLOv8n在Zynq上部署时，DSP资源不够用怎么办？可以用LUT算乘法替代吗？

1小时前

我们团队今年备赛FPGA大赛，选了Zynq做实时目标检测，用的是YOLOv8n模型。在Vivado里综合后发现DSP资源爆了，差了大概40多个。导师建议用LUT加寄存器搭乘法器来替代，但我不确定这样会不会影响时序和功耗。有没有大佬做过类似的优化？具体怎么分配资源才能既满足精度又不超资源？求真实工程经验，特别是国产安路FPGA上有没有类似的坑？

单片机菜鸟

这家伙真懒，几个字都不愿写！

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