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2026年，FPGA大赛做实时车牌识别，用国产安路FPGA部署YOLOv8n时BRAM不够，怎么用模型剪枝和DSP复用解决？

Verilog代码练习生Verilog代码练习生
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6小时前
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我们队选了国产安路FPGA做实时车牌识别，YOLOv8n模型量化后BRAM直接爆了，DSP也只剩几个。试了剪枝和量化，但精度掉到72%，比赛要求至少80%。求具体方案：怎么用逐层剪枝和DSP时分复用把BRAM降下来？安路开发环境有没有类似Xilinx的DPR功能做动态加载？
Verilog代码练习生

Verilog代码练习生

这家伙真懒，几个字都不愿写！
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