2026年，FPGA工程师在AI推理芯片中做原型验证，如何用Verilog高效实现Transformer的矩阵乘法单元？

3小时前

最近面试了一家AI芯片公司，面试官问怎么用Verilog实现Transformer中的矩阵乘法单元，要求支持AXI4-Stream接口。我只会写简单的MAC累加器，但听说现在都用脉动阵列和分块矩阵乘法来优化吞吐量。请问各位大佬，在FPGA上做这种加速器时，如何设计数据复用策略和流水线划分？有没有开源项目可以参考？2026年AI芯片原型验证对FPGA工程师的要求是不是更高了？

数字IC萌新

这家伙真懒，几个字都不愿写！

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