2026年，全国大学生电子设计竞赛FPGA赛题基于Zynq的实时语音关键词识别系统，如何用HLS实现神经网络加速并控制延迟在50ms以内？

3小时前

我们团队准备参加2026年全国大学生电赛，选了基于Zynq的实时语音关键词识别赛题。打算用HLS实现一个小型神经网络加速器，但担心延迟超过50ms影响评分。请问如何从网络量化、流水线深度和DMA传输角度优化？另外，训练好的模型（比如基于MFCC特征的CNN）如何高效映射到FPGA上？HLS优化指令（如pipeline、unroll）该怎么用？

Verilog萌新

这家伙真懒，几个字都不愿写！

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