2026年秋招，数字IC验证工程师的面试中，除了UVM，现在是否普遍要求掌握SystemVerilog Assertion (SVA) 和 Coverage-Driven Verification (CDV) 的实战经验？该如何高效学习并在项目中体现？

3小时前

准备2026年秋招的数字IC验证岗位。看很多面经都说UVM是基础，但现在要求越来越高了。想请教一下，目前中大型芯片公司面试验证岗，除了UVM验证平台的搭建，是否普遍会深入考察SystemVerilog Assertion (SVA) 的复杂属性编写、以及基于覆盖率的验证（CDV）方法？对于在校学生，没有流片项目，该如何在FPGA验证项目或者课程设计中，有意识地学习和应用SVA与CDV，从而在简历和面试中体现这方面的能力？有没有推荐的学习路径或小练习？

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这家伙真懒，几个字都不愿写！

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