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2026年秋招尾声,还有哪些公司的‘模拟IC设计’或‘电源管理IC(PMIC)’岗位可能仍有补招?对于项目经验是Bandgap、LDO的硕士,该如何针对性准备并主动联系HR或工程师争取机会?

Verilog入门者Verilog入门者
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11小时前
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秋招主投数字IC,结果不理想。现在想试试模拟IC方向,硕士课题做过Bandgap和LDO。已经到秋招尾声了,请问还有哪些公司(包括国产芯片公司)的模拟IC或PMIC岗位可能没招满?对于我这种项目经验比较基础的学生,在准备面试时,是应该深挖Bandgap/LDO的每一个设计细节和仿真指标,还是应该快速补充学习一下DC-DC(Buck/Boost)的系统架构和设计要点?另外,如何通过LinkedIn、脉脉或者公司官网找到对应的HR或工程师进行自荐?
Verilog入门者

Verilog入门者

这家伙真懒,几个字都不愿写!
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2026年,工作4年的数字IC设计工程师,感觉在现有平台做IP集成成长有限,想跳槽到做‘高速SerDes PHY’或‘DDR/LPDDR接口控制器’的团队,需要恶补哪些关于模拟混合信号基础、信号完整性、协议和电路设计的知识?上一篇
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  • FPGA学号3

    FPGA学号3

    兄弟,你这情况我熟,去年我也是秋招尾声才转向模拟的。首先,机会肯定有!很多公司的招聘计划是动态的,特别是现在国产替代火,一些公司项目上线急要人。除了楼上提到的大厂,可以看看一些正在发力的公司,比如帝奥微、芯朋微、希荻微,还有不少初创公司,他们可能没那么正规的秋招流程,常年都在看人。

    准备策略上,我有个不同的角度:深度挖掘Bandgap/LDO是必须的,但同时也需要快速搭建一个对PMIC系统的认知。因为面PMIC岗位,面试官可能会问你,Bandgap在PMIC里放在哪,给哪些模块供电?LDO和DC-DC在系统中怎么选型?所以,我建议你花几天时间,把DC-DC(Buck)的基本架构、工作原理、关键模块(比较器、误差放大器、功率管驱动)搞明白,重点是理解它和LDO在应用上的区别(效率、纹波、面积)。这样在面试时,你可以说‘我深入研究了Bandgap和LDO,同时对PMIC系统有整体了解,知道DC-DC的基本原理和设计挑战,如果需要我可以很快上手’。这显得你既有扎实基础,又有学习能力和系统视野。

    主动出击方面,LinkedIn上搜那些公司的‘Talent Acquisition’或‘Recruiter’,直接发InMail。脉脉上可以搜‘模拟IC招聘’相关动态,很多HR和猎头会发帖。发消息时别群发,针对公司稍微修改下内容。附上简历,重点突出你项目的‘完成度’和‘指标’(比如,设计的LDO在xx负载下压差仅xx mV,PSRR达到xx dB),用数字说话。别怕被拒绝,这个阶段了,多试一次就多一次机会。

    9小时前
  • Verilog小白2024

    Verilog小白2024

    秋招尾声补招机会确实不多了,但别灰心。模拟和PMIC方向,可以重点关注一些中小型国产芯片公司,他们招聘周期可能更长,或者有临时增加的headcount。比如圣邦微、矽力杰、南芯、艾为、杰华特这些,每年秋招后可能因为有人拒offer或者业务扩张,有零星补招。建议每天刷一刷他们的官网招聘页和应届生求职网站,设置关键词提醒。

    关于准备,我的建议是:必须深挖Bandgap和LDO,这是你的基本盘。面试官一定会问到你做过的项目,每一个细节都可能被问到,比如Bandgap的曲率补偿具体怎么做的、PSRR怎么仿真和优化的、LDO的负载瞬态响应、环路稳定性。如果你这些基础问题答不好,去学DC-DC会给面试官一种基础不牢、贪多嚼不烂的感觉。把做过的项目吃透,仿真波形、折衷考虑都能说清楚,这比泛泛了解DC-DC更有说服力。

    主动联系的话,脉脉上找在这些公司的员工,特别是模拟设计工程师,礼貌地打招呼,说明你的情况和求职意向,附上简历。可以请教一些技术问题作为切入点,比直接要内推更容易让人接受。官网一般有招聘邮箱,可以发邮件,标题注明“模拟IC设计应届生-姓名-学校”。简历一定要突出你的Bandgap和LDO项目,把关键指标量化。

    9小时前
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