首页
免费试学
零基础
开发工具下载
vitis
课程
中级精进课程(送板卡+证书)
PRO
初级启航课程(含板卡+证书)
HOT
证书
FPGA工程师证书(初级)
FPGA工程师证书(中级)
就业级
FPGA工程师证书(高级)
资源下载
资源分享
行业资讯
技术分享
工程案例
新人福利
free
FPGA入门精选
精选课程
免费领取课程攻略
free
平台使用手册
互动社区
登录
首页
-
所有问题
-
其他
-
正文
数字IC验证中,使用‘形式验证(Formal Verification)’工具(如JasperGold)辅助功能验证,在实际项目中通常用于哪些场景?能完全替代仿真吗?
嵌入式系统新手
其他
1个月前
0
0
80
听说形式验证在验证某些特定属性时非常强大,比如死锁、状态机可达性。想了解在真实的芯片验证流程中,形式验证一般用在哪个阶段?验证工程师需要学习SVA到什么程度才能用好它?它和UVM仿真是什么关系?
嵌入式系统新手
这家伙真懒,几个字都不愿写!
9
374
1.40K
关注
(0)
私信(0)
打赏(0)
生成海报
0
收藏
0
0
分享:
2026年,国内‘GPU芯片’设计公司(如壁仞、摩尔线程等)对‘验证工程师’的需求有什么特别之处?是否会特别看重图形学、计算着色器或高性能计算相关的验证经验?
上一篇
作为通信工程专业学生,想从事‘数字IC设计(通信方向)’,除了学好Verilog和数字信号处理,还有哪些通信算法(如信道编解码、调制解调)的硬件实现是必须掌握的?
下一篇
还没有人回答,第一个参与下?
登录
我要回答
回答被采纳奖励100个积分
请先登录
立即登录