数字IC笔试题中，关于‘时钟门控（Clock Gating）’的低功耗设计，通常会考察哪些具体电路实现和时序分析问题？

硅农预备役2024

1个月前

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低功耗设计是笔试重点，时钟门控更是基础。除了概念，面试官常会问：1. 基于锁存器的时钟门控单元电路图是怎样的？为什么用锁存器不用触发器？2. 时钟门控引入后，对时钟树的 skew 和 latency 有什么影响？3. 在综合和静态时序分析（STA）时，如何处理门控时钟？希望得到一些结合电路和流程的深入解析。

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这家伙真懒，几个字都不愿写！

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