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2026年，FPGA工程师面试被问如何用Verilog实现一个支持AXI4-Stream的流量整形器，该如何从令牌桶算法和状态机角度设计？

嵌入式入门生嵌入式入门生
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4小时前
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我最近面试一家通信公司的FPGA岗，被问到如何用Verilog实现一个支持AXI4-Stream接口的流量整形器。我大概知道令牌桶算法，但不知道如何用状态机实现，以及如何处理AXI4-Stream的ready/valid握手。请问具体设计思路是什么？需要考虑哪些边界条件？有没有参考代码或架构？
嵌入式入门生

嵌入式入门生

这家伙真懒，几个字都不愿写！
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