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只会Verilog写RTL，找不到FPGA工作怎么办？

Verilog小白在路上Verilog小白在路上
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3个月前
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今年秋招投了很多FPGA开发工程师的岗位，但面试发现要求都好高。除了Verilog编码，还要求会时序约束、仿真验证（UVM）、高速接口（如PCIe、DDR）、甚至算法加速和软硬协同。我平时只在学校做过几个小模块，这些高级技能都不会。感觉很迷茫，现在应该重点补哪方面的知识才能达到企业的要求？
Verilog小白在路上

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这家伙真懒，几个字都不愿写！
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